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Line 1: Line 1:
Décrire ici « GroupeSen/EnSeignement/CycleOptionnelunifié/Elec240Archi ». #acl GroupeSen/MembPermGroup:read,write,delete,revert,admin All:read
Line 3: Line 3:
[:GroupeSen/EnSeignement/CycleOptionnelunifié/TdFiltreMedian:TD Verilog : Le filtre Median]
Line 4: Line 5:
Liste des projets : [:GroupeSen/EnSeignement/CycleOptionnelunifié/LesProjets:Les projets]
Line 6: Line 7:
 * Emulation en FPGA d'un circuit sécurisé [:GroupeSen/EnSeignement/CycleOptionnelunifié/MaquetteArm:Maquette ARM FS44BOXII]
Line 8: Line 9:
[:/ArmTD1:Prise en main de la maquette ARM]
Line 9: Line 11:
 * Appareil photo numérique [:GroupeSen/EnSeignement/CycleOptionnelunifié/TD2:Etude de l'interface "ATA" de la maquette ARM]

 

[:GroupeSen/EnSeignement/CycleOptionnelunifié/TdFiltreMedian:TD Verilog : Le filtre Median]

[:GroupeSen/EnSeignement/CycleOptionnelunifié/LesProjets:Les projets]

[:GroupeSen/EnSeignement/CycleOptionnelunifié/MaquetteArm:Maquette ARM FS44BOXII]

[:/ArmTD1:Prise en main de la maquette ARM]

[:GroupeSen/EnSeignement/CycleOptionnelunifié/TD2:Etude de l'interface "ATA" de la maquette ARM]

ComElec: GroupeSen/EnSeignement/CycleOptionnelunifié/Elec240Archi (last edited 2008-01-29 13:07:08 by ecaz)