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[:GroupeSen/EnSeignement/CycleOptionnelunifié/LesProjets:Les projets] = COURS =
== Verilog ==
Cours en ligne : http://www.comelec.enst.fr/hdl
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[:/MaquetteArm:Maquette ARM FS44BOXII] == Architectures ==
 * Architectures des systèmes électroniques numériques : attachment:ARCHI.pdf
 * Architectures des FPGAs : attachment:archi_CLP.pdf
 * Architecture de l'ARM7 : attachment:arm.pdf
= TDs =
== Verilog ==
[:GroupeSen/EnSeignement/CycleOptionnelunifié/Elec240Archi/TdFiltreMedian:TD Verilog : Le filtre Median] =http://comelec.enst.fr/amen/SMLP/TPs/verilog/index.html
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[:/ArmTD1:Prise en main de la maquette ARM] == ARM ==
[:GroupeSen/EnSeignement/CycleOptionnelunifié/Elec240Archi/ArmTD1:TD1 : Prise en main de la maquette ARM FS44BOXII]
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[:/ArmTD2:Etude de l'interface "ATA" de la maquette ARM] [:GroupeSen/EnSeignement/CycleOptionnelunifié/Elec240Archi/ArmTD2:TD2 : Etude de l'interface "ATA" de la maquette ARM FS44BOXII]

== FPGA ==
[:GroupeSen/EnSeignement/CycleOptionnelunifié/Elec240Archi/De2TD1:TD1 : Prise en main de la maquette ALTERA DE2]

[:GroupeSen/EnSeignement/CycleOptionnelunifié/Elec240Archi/De2TD2:TD2 : Réalisation d'une interface entre FS44BOXII/DE2 via l'interface "ATA"]

= PROJETS =
== mini-PROJET (pour Master M2) ==
[:GroupeSen/EnSeignement/CycleOptionnelunifié/Elec240Archi/MiniProjet:Le mini projet]

== Sujets de Projets (pour COU) ==
[:GroupeSen/EnSeignement/CycleOptionnelunifié/Elec240Archi/LesProjets:Les projets]

= Documentation =
== cartes et composants ==
 * [:GroupeSen/EnSeignement/CycleOptionnelunifié/Elec240Archi/De2Doc:Documentations de la carte ALTERA DE2]
 * ARM :
== Administration ==
 * Reflashage de la carte ARM :[:GroupeSen/EnSeignement/CycleOptionnelunifié/Elec240Archi/MaquetteArm:Gestion de la Maquette ARM FS44BOXII]

TableOfContents(3)

COURS

Verilog

Cours en ligne : http://www.comelec.enst.fr/hdl

Architectures

  • Architectures des systèmes électroniques numériques : attachment:ARCHI.pdf
  • Architectures des FPGAs : attachment:archi_CLP.pdf
  • Architecture de l'ARM7 : attachment:arm.pdf

TDs

Verilog

[:GroupeSen/EnSeignement/CycleOptionnelunifié/Elec240Archi/TdFiltreMedian:TD Verilog : Le filtre Median] =http://comelec.enst.fr/amen/SMLP/TPs/verilog/index.html

ARM

[:GroupeSen/EnSeignement/CycleOptionnelunifié/Elec240Archi/ArmTD1:TD1 : Prise en main de la maquette ARM FS44BOXII]

[:GroupeSen/EnSeignement/CycleOptionnelunifié/Elec240Archi/ArmTD2:TD2 : Etude de l'interface "ATA" de la maquette ARM FS44BOXII]

FPGA

[:GroupeSen/EnSeignement/CycleOptionnelunifié/Elec240Archi/De2TD1:TD1 : Prise en main de la maquette ALTERA DE2]

[:GroupeSen/EnSeignement/CycleOptionnelunifié/Elec240Archi/De2TD2:TD2 : Réalisation d'une interface entre FS44BOXII/DE2 via l'interface "ATA"]

PROJETS

mini-PROJET (pour Master M2)

[:GroupeSen/EnSeignement/CycleOptionnelunifié/Elec240Archi/MiniProjet:Le mini projet]

Sujets de Projets (pour COU)

[:GroupeSen/EnSeignement/CycleOptionnelunifié/Elec240Archi/LesProjets:Les projets]

Documentation

cartes et composants

Administration

ComElec: GroupeSen/EnSeignement/CycleOptionnelunifié/Elec240Archi (last edited 2008-01-29 13:07:08 by ecaz)