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| [[TableOfContents(3)]] = COURS = == Verilog == Cours en ligne : http://www.comelec.enst.fr/hdl == Architectures == * Architectures des systèmes électroniques numériques : attachment:ARCHI.pdf * Architectures des FPGAs : attachment:archi_CLP.pdf * Architecture de l'ARM7 : attachment:arm.pdf = TDs = == Verilog == [:/TdFiltreMedian:TD Verilog : Le filtre Median] =http://www.comelec.enst.fr/amen/SMLP/TPs/verilog/index.html == ARM == [:/ArmTD1:TD1 : Prise en main de la maquette ARM FS44BOXII] [:/ArmTD2:TD2 : Etude de l'interface "ATA" de la maquette ARM FS44BOXII] == FPGA == [:/De2TD1:TD1 : Prise en main de la maquette ALTERA DE2] [:/De2TD2:TD2 : Réalisation d'une interface entre FS44BOXII/DE2 via l'interface "ATA"] |
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| '''Liste des projets :''' * Emulation en FPGA d'un circuit sécurisé |
= PROJETS = == mini-PROJET == |
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| * Appareil photo numérique | == Sujets de Projets == [:/LesProjets: Les projets] = Documentation = [:/De2Doc: Documentations de la carte ALTERA DE2] == Administration == [:/MaquetteArm: Gestion de la Maquette ARM FS44BOXII] |
COURS
Verilog
Cours en ligne : http://www.comelec.enst.fr/hdl
Architectures
- Architectures des systèmes électroniques numériques : attachment:ARCHI.pdf
- Architectures des FPGAs : attachment:archi_CLP.pdf
- Architecture de l'ARM7 : attachment:arm.pdf
TDs
Verilog
[:/TdFiltreMedian:TD Verilog : Le filtre Median] =http://www.comelec.enst.fr/amen/SMLP/TPs/verilog/index.html
ARM
[:/ArmTD1:TD1 : Prise en main de la maquette ARM FS44BOXII] [:/ArmTD2:TD2 : Etude de l'interface "ATA" de la maquette ARM FS44BOXII]
FPGA
[:/De2TD1:TD1 : Prise en main de la maquette ALTERA DE2]
[:/De2TD2:TD2 : Réalisation d'une interface entre FS44BOXII/DE2 via l'interface "ATA"]
PROJETS
mini-PROJET
Sujets de Projets
[:/LesProjets: Les projets]
Documentation
[:/De2Doc: Documentations de la carte ALTERA DE2]
Administration
[:/MaquetteArm: Gestion de la Maquette ARM FS44BOXII]