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| [:GroupeSen/EnSeignement/CycleOptionnelunifié/TdFiltreMedian:TD Verilog : Le filtre Median] | == Les Cours Verilog == |
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| [:GroupeSen/EnSeignement/CycleOptionnelunifié/LesProjets:Les projets] | [:/TdFiltreMedian:TD1 Verilog : Le filtre Median] |
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| [:GroupeSen/EnSeignement/CycleOptionnelunifié/MaquetteArm:Maquette ARM FS44BOXII] | == Les cours sur le processeur ARM == |
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| [:GroupeSen/EnSeignement/CycleOptionnelunifié/TD1:Prise en main de la maquette ARM] | [:/ArmTD1:TD1 : Prise en main de la maquette ARM FS44BOXII] |
| Line 11: | Line 11: |
| * Emulation en FPGA d'un circuit sécurisé | [:/ArmTD2:TD2 : Etude de l'interface "ATA" de la maquette ARM FS44BOXII] |
| Line 13: | Line 13: |
| == Les Cours sur la maquette DE2 == | |
| Line 14: | Line 15: |
| * Appareil photo numérique | [:/De2TD1:TD1 : Prise en main de la maquette ALTERA DE2] [:/De2TD2:TD2 : Réalisation d'une interface entre FS44BOXII/DE2 via l'interface "ATA"] == Administration == [:/LesProjets: Les projets] [:/MaquetteArm:Maquette ARM FS44BOXII] |
Les Cours Verilog
[:/TdFiltreMedian:TD1 Verilog : Le filtre Median]
Les cours sur le processeur ARM
[:/ArmTD1:TD1 : Prise en main de la maquette ARM FS44BOXII]
[:/ArmTD2:TD2 : Etude de l'interface "ATA" de la maquette ARM FS44BOXII]
Les Cours sur la maquette DE2
[:/De2TD1:TD1 : Prise en main de la maquette ALTERA DE2]
[:/De2TD2:TD2 : Réalisation d'une interface entre FS44BOXII/DE2 via l'interface "ATA"]
Administration
[:/LesProjets: Les projets]
[:/MaquetteArm:Maquette ARM FS44BOXII]